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Created with Pixso. À la maison Created with Pixso. Produits Created with Pixso.
Puce de circuit intégré
Created with Pixso. XC2S50E-6TQ144C Port de champ programmable FPGA

XC2S50E-6TQ144C Port de champ programmable FPGA

Brand Name: Original
Model Number: XC2S50E-6TQ144C
MOQ: 1
Prix: negotiable
Delivery Time: 3-4 jours
Payment Terms: TT
Detail Information
Lieu d'origine:
Originaux
Certification:
Original
Le paquet:
Plateau
Nombre de LAB/CLB:
384
Nombre d'éléments logiques/cellules:
1728
Total des bits de mémoire vive:
32768
Nombre d'entrées/sorties:
102
Nombre de portes:
50000
Voltage - alimentation:
1.71V ~ 1.89V
Température de fonctionnement:
0°C à 85°C (TJ)
Détails d'emballage:
boîte en carton
Capacité d'approvisionnement:
100
Mettre en évidence:

XC2S50E-6TQ144C

,

Le système d'exploitation de l'appareil doit être équipé d'un système d'exploitation de l'appareil

,

qui doit être équipé d'un système d'exploitation de l'appareil.

Product Description

XC2S50E-6TQ144C Field Programmable Gate Array (FPGA) IC 102 32768

 

Les XC2S50E-6TQ144C sont issus deInventaire d'usine, s'il vous plaît vérifier vos demandes et s'il vous plaît contactez-nous avec le prix cible.
 
Les spécifications de Le système de détection de l'urine doit être conforme à l'annexe II.

 
Le type Définition
Catégorie Circuits intégrés (CI)
  Incorporé
  FPGA (Field Programmable Gate Array) est un ensemble de données qui est utilisé pour les opérations de programmation.
Mfr L'AMD
Série Spartan®-IIE
Le paquet Plateau
Nombre de LAB/CLB 384
Nombre d'éléments logiques/cellules 1728
Total des bits de mémoire vive 32768
Nombre d'entrées/sorties 102
Nombre de portes 50000
Voltage - alimentation 1.71V ~ 1.89V
Type de montage Monture de surface
Température de fonctionnement 0°C à 85°C (TJ)
Emballage / boîtier 144-LQFP
Paquet de dispositifs fournis par le fournisseur Le nombre d'heures d'essai est le suivant:
Numéro du produit de base Pour les véhicules à moteur électrique

 
Caractéristiques duLe système de détection de l'urine doit être conforme à l'annexe II.
 
• les personnes âgéesTechnologie de remplacement ASIC de deuxième génération

-Densités allant jusqu'à 15 552 cellules logiques600,000 portes du système

-Des fonctionnalités simplifiées basées sur Virtex®

- E FPGAl'architecture-Illimité dans le systèmeréprogrammabilité

-Coût très bas-Technologie rentable à 0,15 micron

• les personnes âgéesCaractéristiques au niveau du système

-Mémoire hiérarchique SelectRAMTM:

·RAM distribuée à 16 bits/LUT

·RAM de bloc à double port 4K-bit configurable

·Interfaces rapides avec la RAM externe

-une tension de 3,3 V conforme à la norme PCI à 64 bits à 66 MHz etCompatible avec CardBus

-Architecture de routage segmenté à faible consommation

-Logique de transport dédiée pour l'arithmétique à grande vitesse

-Soutien efficace des multiplicateurs

-Chaîne en cascade pour large

- fonctions d'entrée

-Registre/verrouillage abondant avec activation, réglage, réinitialisation

-Quatre DLL dédiées pour le contrôle avancé de l'horloge

      ·Éliminer le retard de distribution de l' horloge

      ·Multiplier, diviser ou changer de phase-Quatre primairesfaible

- déformé.le monde entierl'horlogedistributionles filets

  -Logique de balayage des limites compatible avec l'IEEE 1149.1

• les personnes âgéesÉquipement d'emballage et d'entrée/sortie polyvalents

   -Options de forfait sans Pb

-Faible

- les forfaits de coûts disponibles dans toutes les densités

-L'empreinte familialeility dans les emballages communs

   -19 normes d'interface de haute performance·Les États membres doivent fournir à l'autorité compétente les informations suivantes:·Le système d'entrée/sortie différentielle LVDS et LVPECL

-jusqu'à 205 paires d'E/S différentielles pouvant être entrées,sortie, ou bidirectionnelle

-L'échange à chaud I/O (compactPCI compatible)

• les personnes âgéesune puissance de 1,8 V et une puissance de 1,5 V,2.5V ou 3.3V

• les personnes âgéesEntièrement supporté par le puissant Xilinx®ÉIU®le développementsystème

   -Cartographie, placement et routage entièrement automatiques

-Intégré avec les outils d'entrée de conception et de vérification

   -Bibliothèque IP étendue comprenant les fonctions DSP etmachines de traitement des matières douces
 

Famille Spartan-IIE comparée à Spartan-IIFamille

 

• les personnes âgéesDensité plus élevée et plus d'E/S

• les personnes âgéesDes performances plus élevées

• les personnes âgéesPinouts uniques dans des emballages rentables

• les personnes âgéesSignalisation différentielle-Le système d'exploitation de l'appareil doit être équipé d'un système d'exploitation de l'appareil, qui doit être équipé d'un système d'exploitation de l'appareil.

• VLe CCINT= 1,8 V- Moins de puissance.-Tolérance de 5 V avec résistance externe-Tolérance directe de 3 V

• les personnes âgéesLes tampons d'entrée PCI, LVTTL et LVCMOS2 alimentés parVLe CCOau lieu de VLe CCINT

• les personnes âgéesFlux de bits unique plus grand


Classifications environnementales et d'exportationLe système de détection de l'urine doit être conforme à l'annexe II.

 

Attribut Définition
Statut de la réglementation RoHS Non conforme à la directive RoHS
Niveau de sensibilité à l'humidité (MSL) 3 (168 heures)
Statut REACH REACH Non affecté
Nom de la banque EAR99
HTSUS 8542.39.0001

 
XC2S50E-6TQ144C Port de champ programmable FPGA 0

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Puce de circuit intégré
Created with Pixso. XC2S50E-6TQ144C Port de champ programmable FPGA

XC2S50E-6TQ144C Port de champ programmable FPGA

Brand Name: Original
Model Number: XC2S50E-6TQ144C
MOQ: 1
Prix: negotiable
Packaging Details: boîte en carton
Payment Terms: TT
Detail Information
Lieu d'origine:
Originaux
Nom de marque:
Original
Certification:
Original
Numéro de modèle:
XC2S50E-6TQ144C
Le paquet:
Plateau
Nombre de LAB/CLB:
384
Nombre d'éléments logiques/cellules:
1728
Total des bits de mémoire vive:
32768
Nombre d'entrées/sorties:
102
Nombre de portes:
50000
Voltage - alimentation:
1.71V ~ 1.89V
Température de fonctionnement:
0°C à 85°C (TJ)
Quantité de commande min:
1
Prix:
negotiable
Détails d'emballage:
boîte en carton
Délai de livraison:
3-4 jours
Conditions de paiement:
TT
Capacité d'approvisionnement:
100
Mettre en évidence:

XC2S50E-6TQ144C

,

Le système d'exploitation de l'appareil doit être équipé d'un système d'exploitation de l'appareil

,

qui doit être équipé d'un système d'exploitation de l'appareil.

Product Description

XC2S50E-6TQ144C Field Programmable Gate Array (FPGA) IC 102 32768

 

Les XC2S50E-6TQ144C sont issus deInventaire d'usine, s'il vous plaît vérifier vos demandes et s'il vous plaît contactez-nous avec le prix cible.
 
Les spécifications de Le système de détection de l'urine doit être conforme à l'annexe II.

 
Le type Définition
Catégorie Circuits intégrés (CI)
  Incorporé
  FPGA (Field Programmable Gate Array) est un ensemble de données qui est utilisé pour les opérations de programmation.
Mfr L'AMD
Série Spartan®-IIE
Le paquet Plateau
Nombre de LAB/CLB 384
Nombre d'éléments logiques/cellules 1728
Total des bits de mémoire vive 32768
Nombre d'entrées/sorties 102
Nombre de portes 50000
Voltage - alimentation 1.71V ~ 1.89V
Type de montage Monture de surface
Température de fonctionnement 0°C à 85°C (TJ)
Emballage / boîtier 144-LQFP
Paquet de dispositifs fournis par le fournisseur Le nombre d'heures d'essai est le suivant:
Numéro du produit de base Pour les véhicules à moteur électrique

 
Caractéristiques duLe système de détection de l'urine doit être conforme à l'annexe II.
 
• les personnes âgéesTechnologie de remplacement ASIC de deuxième génération

-Densités allant jusqu'à 15 552 cellules logiques600,000 portes du système

-Des fonctionnalités simplifiées basées sur Virtex®

- E FPGAl'architecture-Illimité dans le systèmeréprogrammabilité

-Coût très bas-Technologie rentable à 0,15 micron

• les personnes âgéesCaractéristiques au niveau du système

-Mémoire hiérarchique SelectRAMTM:

·RAM distribuée à 16 bits/LUT

·RAM de bloc à double port 4K-bit configurable

·Interfaces rapides avec la RAM externe

-une tension de 3,3 V conforme à la norme PCI à 64 bits à 66 MHz etCompatible avec CardBus

-Architecture de routage segmenté à faible consommation

-Logique de transport dédiée pour l'arithmétique à grande vitesse

-Soutien efficace des multiplicateurs

-Chaîne en cascade pour large

- fonctions d'entrée

-Registre/verrouillage abondant avec activation, réglage, réinitialisation

-Quatre DLL dédiées pour le contrôle avancé de l'horloge

      ·Éliminer le retard de distribution de l' horloge

      ·Multiplier, diviser ou changer de phase-Quatre primairesfaible

- déformé.le monde entierl'horlogedistributionles filets

  -Logique de balayage des limites compatible avec l'IEEE 1149.1

• les personnes âgéesÉquipement d'emballage et d'entrée/sortie polyvalents

   -Options de forfait sans Pb

-Faible

- les forfaits de coûts disponibles dans toutes les densités

-L'empreinte familialeility dans les emballages communs

   -19 normes d'interface de haute performance·Les États membres doivent fournir à l'autorité compétente les informations suivantes:·Le système d'entrée/sortie différentielle LVDS et LVPECL

-jusqu'à 205 paires d'E/S différentielles pouvant être entrées,sortie, ou bidirectionnelle

-L'échange à chaud I/O (compactPCI compatible)

• les personnes âgéesune puissance de 1,8 V et une puissance de 1,5 V,2.5V ou 3.3V

• les personnes âgéesEntièrement supporté par le puissant Xilinx®ÉIU®le développementsystème

   -Cartographie, placement et routage entièrement automatiques

-Intégré avec les outils d'entrée de conception et de vérification

   -Bibliothèque IP étendue comprenant les fonctions DSP etmachines de traitement des matières douces
 

Famille Spartan-IIE comparée à Spartan-IIFamille

 

• les personnes âgéesDensité plus élevée et plus d'E/S

• les personnes âgéesDes performances plus élevées

• les personnes âgéesPinouts uniques dans des emballages rentables

• les personnes âgéesSignalisation différentielle-Le système d'exploitation de l'appareil doit être équipé d'un système d'exploitation de l'appareil, qui doit être équipé d'un système d'exploitation de l'appareil.

• VLe CCINT= 1,8 V- Moins de puissance.-Tolérance de 5 V avec résistance externe-Tolérance directe de 3 V

• les personnes âgéesLes tampons d'entrée PCI, LVTTL et LVCMOS2 alimentés parVLe CCOau lieu de VLe CCINT

• les personnes âgéesFlux de bits unique plus grand


Classifications environnementales et d'exportationLe système de détection de l'urine doit être conforme à l'annexe II.

 

Attribut Définition
Statut de la réglementation RoHS Non conforme à la directive RoHS
Niveau de sensibilité à l'humidité (MSL) 3 (168 heures)
Statut REACH REACH Non affecté
Nom de la banque EAR99
HTSUS 8542.39.0001

 
XC2S50E-6TQ144C Port de champ programmable FPGA 0